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06-陈韬宇.pdf

上传人: 山哈 编号:725339 2025-07-04 37页 1.75MB

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本文主要介绍了中国科学院软件研究所、计算技术研究所和北京开源芯片研究院在香山缓存系统形式化验证方面的研究。关键点如下: 1. 香山缓存系统采用敏捷开发流程,使用Diplomacy框架实现组件互联,但敏捷开发带来的验证困难较大。 2. 形式化验证技术应用于香山缓存系统,关注互斥性质和死锁性质,发现并修复了设计疏漏和死锁场景。 3. 验证流程包括设计辅助模块、调整验证参数、导出Verilog代码和运行验证算法等步骤。 4. 香山缓存系统建模涉及L1、L2、L3和RAM,形成约18万行Verilog代码的巨大电路。 5. 研究团队开发了ChiselFV工具,实现了Chisel到Verilog的形式化验证链。 6. 阶段性成果包括发现并修复了互斥性质和死锁性质的相关错误,提高了验证敏捷度。 7. 未来研究方向包括关注更多缓存性质、提高验证敏捷度和封装可复用的接口。 核心数据:香山缓存系统约2万行Chisel代码转化为18万行Verilog代码;发现并修复了互斥性质和死锁性质的相关错误。
"香山缓存有哪些验证难点?" "形式化验证如何助力香山缓存?" "香山缓存未来研究方向是啥?"
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